ビジネスタイプ:メーカー、トレーダー、輸出業者
年商:8000万〜1億元
従業員数:100-150
市場範囲:世界中
設立年:2003
国内のお客様:500以上
外国のお客様:100以上
コア特許:60+

日付:2019年11月12〜15日、ドイツのProductronicaMünchenにご参加ください。
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静電放電による損傷からチップを保護する方法

数ブラウズ:0     著者:サイトエディタ     公開された: 2020-11-30      起源:パワード

今日の電子製品では、集積回路内に堅固なESD構造を設計することにより、すべてのESD基板をカバーする必要がありますが、ほとんどの場合、エンジニアはデバイスが安全で準拠していることをデフォルトとし、ESD保護が考慮されることはめったにありません。

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ESD(静電放電)は「静電放電」を意味します。 ESDは、20世紀半ば以降、静電気の発生、害、保護を研究するために形成された分野です。したがって、静電保護に使用される機器をESDと呼ぶのが通例であり、中国名は静電インピーダンス装置です。

静電放電またはESDの定義は、異なる静電ポテンシャルの下での物体または表面間の静電荷の移動です。放電により、1〜100ナノ秒(ns)のキロボルト(kV)範囲の超高電圧が短時間で放出されます。ご想像のとおり、これらのタイプの電圧および時間単位の場合、ESDイベントには速いエッジがあります。このようなイベントが発生すると、静電荷の急速な移動により、目に見えるまたは目に見えない火花が発生する可能性があります。

ESDは通常、敏感な電子機器によってのみ検出されます。ESD保護なしで機器に触れると、個人が無意識のうちにデバイスに破壊的な損傷を与える可能性があります。高度に充電されたESD環境では、パッケージ内のESD保護シリコンチップが破壊されます(図1)。

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図1.チップのESD損傷の拡大例。金属トレースの消失、パッシベーションクラック、および一種の熱移動を示しています。

図1では、チップにESDイベントがあり、引き起こされた損傷は壊滅的であり、金属トレースの蒸発、不動態化領域の損傷、電熱移動のソフトエラーの可能性があります。技術的に言えば、回路がまだ機能する場合、ソフトエラー(仕様の劣化など)が将来発生する可能性があります。

このタイプの損傷は、パッケージングプロセス中、またはチップがPCBに組み立てられる前に発生する可能性が最も高くなります。 ICの内部ESD保護回路は、組み立て前のプロセスおよび組み立て操作中にチップをある程度保護します。この環境では、低インピーダンスの接地経路が放電経路として使用されます。パッケージングおよびテスト環境では、低インピーダンスの接地経路の実現には、リストストラップ、接地床、接地デスクトップ、およびESDイオンジェネレーター(イオンファン、イオン風ロッド、イオン風ノズル、イオン風ナイフ、宇宙ESD機器など)が含まれます。 ICがPCBに取り付けられ、他のコンポーネントと相互接続されると、この保護された環境は大幅に削減されます。適切なESD制御と防止を通じてESDの損傷を減らす必要があります。

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周囲の環境と相互作用すると、静的な火花が発生することがよくあります。これらの静的な電気は、チップの本来の特性を破壊します。このような事故により、毎年数十億ドルの損失が発生します。最終製品を選択する前に、必ず実験室での適切なESD予防策に従い、製品データシートのESD保護仕様を確認してください。


KESDについて

KESDは2003年に設立され、長年にわたり除電製品の研究、開発、生産、販売に取り組んでおり、その中核製品はイオンファン、イオン風ロッド、イオンノズル、電気集塵機です。

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